
[반도체IP설계] RTL설계&검증 엔지니어
요약
- 마감일
- 2026.09.02~9/2(수)
- 직무
- 기술지원, 하드웨어 개발
- 경력
- 5 ~ 12년
- 고용형태
- 정규직
- 근무지역
- 서울
- 스킬
- java, c, python, 하드웨어, RTL, verilog, RTL설계
기업 소개
"Video Technology Leader for Silicon HW IP"
칩스앤미디어는 반도체 설계자산 전문 기업입니다. 반도체 설계자산은 반도체 칩에 삽입되어 특정 기능을 수행하는 블록으로 일반적으로 ‘Silicon IP’라고 하는데, 반도체 IP중에서도 칩스앤미디어는 비디오 IP를 주력으로 연구개발합니다.
당사의 기술은 반도체 칩 제조사에 비디오 IP를 라이선스하고, 반도체 칩 회사는 당사의 비디오 기술을 활용하여 스마트폰이나 디지털TV, 자동차 등의 반도체 칩을 완성합니다.
칩스앤미디어는 20여 년간 비디오IP 기술을 축적하여 전세계 150여 개 기업에 IP를 제공하고 있으며, 글로벌 비디오 IP로써 최고의 기술을 보유하고 있습니다.
칩스앤미디어는 반도체 설계자산 전문 기업입니다. 반도체 설계자산은 반도체 칩에 삽입되어 특정 기능을 수행하는 블록으로 일반적으로 ‘Silicon IP’라고 하는데, 반도체 IP중에서도 칩스앤미디어는 비디오 IP를 주력으로 연구개발합니다.
당사의 기술은 반도체 칩 제조사에 비디오 IP를 라이선스하고, 반도체 칩 회사는 당사의 비디오 기술을 활용하여 스마트폰이나 디지털TV, 자동차 등의 반도체 칩을 완성합니다.
칩스앤미디어는 20여 년간 비디오IP 기술을 축적하여 전세계 150여 개 기업에 IP를 제공하고 있으며, 글로벌 비디오 IP로써 최고의 기술을 보유하고 있습니다.
주요 업무
• 개발된 HW IP의 value-added 기능 설계(RTL coding) 및 검증(simulation&systhesis), 유지 보수
• 개발 중인 HW IP에 대한 검증 환경 setup 및 debugging
• 개발 완료된 Product에 대한 Customer지원
• 개발 중인 HW IP에 대한 검증 환경 setup 및 debugging
• 개발 완료된 Product에 대한 Customer지원
자격 요건
• 경력 5년 이상~12년 이하
• 대학교 졸업(4년) 이상
• 전자(공학)과 출신 학사 or 석사
• Verilog , C 기본 지식 보유
• 대학교 졸업(4년) 이상
• 전자(공학)과 출신 학사 or 석사
• Verilog , C 기본 지식 보유
우대 사항
• Python / Perl / JAVA / Shell Script에 대한 지식보유
• 비디오코덱에 대한 지식보유
• FPGA Development Environment 경험
• 영어활용가능자
• 비디오코덱에 대한 지식보유
• FPGA Development Environment 경험
• 영어활용가능자
복리후생
• 유연근무 (Core time 운영/11:30 ~ 15:30)
• 점심식대 지원
• 선택적복리후생비 연 300만원 제공
• Refresh 휴가 및 휴가비 지원
• 연 70만원 상당 건강검진 제공
• 사내 세미나 활성화 등 개발 역량 향상을 위한 지원
• 영어 닉네임 사용
• 학사 신입기준 연봉 5000만원
• 점심식대 지원
• 선택적복리후생비 연 300만원 제공
• Refresh 휴가 및 휴가비 지원
• 연 70만원 상당 건강검진 제공
• 사내 세미나 활성화 등 개발 역량 향상을 위한 지원
• 영어 닉네임 사용
• 학사 신입기준 연봉 5000만원
채용 절차
• 서류전형 > 인터뷰 > 최종 합격
• 채용 전형은 상황에 따라 변경될 수 있습니다.
• 이력서 내용이 사실과 다를 경우, 채용이 취소될 수 있습니다.
• 근무지 : 서울시 강남구 테헤란로 509(삼성동,NC타워1) 7~8F
• 채용 전형은 상황에 따라 변경될 수 있습니다.
• 이력서 내용이 사실과 다를 경우, 채용이 취소될 수 있습니다.
• 근무지 : 서울시 강남구 테헤란로 509(삼성동,NC타워1) 7~8F
회사위치
서울 강남구 테헤란로 509, 엔씨타워1 7층,8층
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- 1차 합격 시면접가이드
- 취업축하금100만원
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